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Date |
Author |
Status |
Type |
Category |
Important |
Subject |
Icon |
Text |
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78
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Thu Dec 21 15:39:35 2023 |
VC | Under Process | Other | Timing |
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mesure synchro | | démarrage mesure stabilité
de "phase" longue durée
(100K pts 10Kpts environ 20mn) |
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77
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Mon Dec 18 08:42:26 2023 |
Entered by Vincent Chaumat from 134.158.76.115 on Mon Dec 18 08:42:10 2023 | Under Process | Info | Timing |
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Mesure Jitter 500MHz versur 10Hz | | Systeme de synchro 500li*500ri 41li&33ri(1ns)
41li
Les mesures sont effectuées |
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76
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Mon Dec 11 08:26:45 2023 |
VC, ND | Under Process | Other | Timing |
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Test programme CPLD | | 8H15 démarrage chiller et modulateur
9H30 Ronde pour fermer la casemate
9h36 Trig |
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75
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Thu Dec 7 14:01:21 2023 |
VC, ND | | Info | Timing |
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Intervention synchro | | Objectif: test du nouveau code CPLD.
- Un montage avait été
installé sur le système de |
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Fri Nov 24 14:12:41 2023 |
Entered by Vincent Chaumat from 134.158.76.115 on Fri Nov 24 14:12:25 2023 | Fixed | Info | Timing |
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Liste des signaux de synchro et de cables utilisés | | distribution du systeme entre baie 8 baie
9 et sous systeme
https://atrium.in2p3.fr/c3aa1ee8-ef12-47c6-b9f0-25641bf71744 |
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73
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Wed Nov 22 16:22:43 2023 |
VC | | Fix | Timing |
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Cablage 500MHz li +mixer500li 500ri | | Le 500MHz Li entre baie 8 et 9 passe par
le cable heliax 90358
baie8-E7 baie 9-D1 |
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72
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Fri Nov 10 17:02:55 2023 |
VC,ND | | Info | Other |
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Test synchro | | Test synchro dont changement de frequence.
Le systeme de génération
du timing (programme CPLD 33li*33Ri (delay |
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Thu Nov 9 13:55:58 2023 |
KD | Under Process | Problem | Material |
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puissance 500MHz RI | | Aujourd'hui la puissance envoyé
par le synthé 500MHz RI était
trop faible (-15dbm au niveau de l'ampli |
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Tue Nov 7 17:14:22 2023 |
VC, ND | | Info | Other |
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Test changement de frequence | | La frequence de l'anneau a ete changee
pour voir le comportement a 500.02MHz.
Mesures a continuer vendredi. |
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Thu Oct 26 17:01:06 2023 |
Entered by Vincent Chaumat from 134.158.76.115 on Thu Oct 26 17:00:50 2023 | Fixed | Info | Timing |
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Schéma de synchro au 26-10-2023 | | le cablage de la synchro en baie 9 a été
'mis au propre" conformément
au schéma ci joint |
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68
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Thu Oct 26 16:16:54 2023 |
Entered by Nicolas Delerue from 134.158.195.143 on Thu Oct 26 16:16:39 2023 | | Info | Other |
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Routage pickup cavite RF => WAC3 | | Pickup cavite RF puissance incidente <=>
Panneau 91501 A1 <=> Baie 9, E2 <=>
Baie 5, WAC3, voie 4 |
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67
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Thu Oct 26 15:53:18 2023 |
ND,VC | | Info | Other |
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RE: Signaux synchro sur WAC3 et WAC1 | | WAC3:
Ch1 debranche
Ch3 = Melange pickup cavite RF, |
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66
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Thu Oct 26 09:47:32 2023 |
VC | Fixed | Info | Timing |
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Mesure jitter 5000MHz | | La mesure du jitter en les 500Li et Ri
est de 7ps Sdev (22ps FW10%)
(les mesures anormalement hautes |
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65
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Fri Oct 20 15:11:30 2023 |
VC, ND | | Info | Other |
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Mesures dephaseur | | Mesure du dephasage par les dephaseurs,
cf images jointes.
Dans la config actuelle le dephaseur |
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Fri Oct 20 14:29:12 2023 |
Entered by Nicolas Delerue from 134.158.195.142 on Fri Oct 20 14:28:56 2023 | | Info | Other |
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Synchro for streak camera | | Signal declencment camera streak: gene
4, canal 9
Routage Streak camera: |
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Thu Oct 19 12:01:18 2023 |
VC, ND | | Info | Other |
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Modifications synchro | | Value initiales phase shifters: 500MHz
et 33MHz: 7.830V(AO6) et 0V (AO7)
Signal 33MHzRI remis sur |
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Wed Oct 18 17:39:57 2023 |
Entered by Super Team from 134.158.195.141 on Wed Oct 18 17:39:42 2023 | Fixed | Info | Timing |
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shift du 18 octobre 2023 | | Le programme CPLD a été modifié
puis remis à (33x33 ==> 33x41 ==>
41MHz avec ligne à retard externe) aujourd'hui |
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Tue Oct 17 16:23:20 2023 |
ND,VC | | Info | Other |
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Signaux synchro sur WAC3 | | Les signaux synchro sont sur ER/CA/RAC.05-ELR.01-WAC.03
Ch7: 500MHz Linac
Ch6: 500MHz Anneau |
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Tue Oct 17 16:23:05 2023 |
ND, VC | Under Process | Info | Other |
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RE: RE: Scope Signaux Baie 9 | | Signaux deplaces sur WAC3
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59
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Tue Oct 17 13:06:54 2023 |
ND, VC | Under Process | Info | Other |
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RE: Scope Signaux Baie 9 | | Voie 2: Mélange des 500MHz + Passe-bas
15MHz
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