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    Reply   VC, ND; RE: Codes de synchro mis a jour (25Hz) 
La limite sur les diags a levee. Ils peuvent passer a 25Hz aussi.




VC,
ND wrote:



Les codes de synchro ont ete mis a jour et testes.
Entry   VC, ND; Mise a jour synchronisation. 
Attention au démarrage de l'interface faire 'restore laser and Kicker' pour etre sur que le systeme de synchro est en mode "normal"

Les codes de synchronisations ont ete mis a jour afin de permettre le 50Hz.

L'interface a ete mise à jour et un git pull a ete fait.
Entry   VC, ND; Recharge constante synchro 8 
Les constantes de synchronisation 8 (sans DEG 4) ont été rechargées. Toutes les valeurs sont remises à celles du 8 juillet
2025.

Les constantes de synchronisation 9 (avec DEG 4) ont été effacées.
Entry   VC, ND; DEG4 retiré pour nettoyage 
Le DEG4 a été retiré pour nettoyage.
Entry   VC, KD, ND; Balayage du depahsage laser scan_laser_shift.jpgscan_gene_with_laser.jpg
Dephasage entre les deux signaux 33MHz en sortie du gene Rigol lors d'un balayage de valeur PhaseShifterPhaseFemtoSeconds dans LI/OP/OPT.02-LAS.01-SPS.01
(figure 1)

Idem avec en plus un balayage en phase de la sortie 1 du Rigol (figure 2).
Entry   VC, KD, ND; Problème double déclenchement DEG TEK00000.PNGTEK00002.PNGTEK00005.PNG
Captrures d'écran voie 5 DEG1 avec Trig ECT=12,5Hz: double déclenche.

Image 1: pas de double déclenche

Image 2: avec double déclenche
Entry   VC, KD; Prêt synthé 3GHz pour White Rabbit 
aujourd'hui 13/05,

le synthé 3GHz de ThomX (R&S SMA) est retiré pour prêt à l'experience sur le White Rabbit.

Un autre synthé le remplace (synthé ThomX R&S SML), les caractéristiques en sortie ont été fixé
Entry   VC RC; Redeclanche des DGs  CH1-N4-CH2_33RI-CH3_500RI-V2.pngCH1-N4-CH2_33RI-CH3_500RI-V3.png
scope (déclenche sur glitch inversé (inférieur à 50ns) CH1
CH1 trigext DeG4 (pris avec 1 "T" scope sur 1MOhm)
CH2 33MHz RI (in trigbox)
Entry   VC; Mesure jitter 5000MHz 
La mesure du jitter en les 500Li et Ri est de 7ps Sdev (22ps FW10%)

(les mesures anormalement hautes du début de semaine étaient dues à une érreur de parametrage de la mesure, seuil 
dT@level en relatif )
Entry   VC; Cablage 500MHz li +mixer500li 500ri 
Le 500MHz Li entre baie 8 et 9 passe par le cable heliax 90358

baie8-E7  baie 9-D1

 
Entry   VC; mesure synchro 
démarrage mesure stabilité de "phase" longue durée (100K pts 10Kpts environ 20mn)

freq Ring 500.25MHz

500li*500ri
Entry   VC; , entered from 134.158.76.115 
Timing opérationnel

les voies des DG2-DG3 sont éteintes

- keep original text -
Entry   VC; Synthé anneau baie 9 
Pb résolu: il fallait etaindre et redémarrer le synthé (le cable réseau avait été débranché et
rebranché pour test ce matin sans que la connexion se refasse)

 
Entry   VC; frequency linac 
La frequence linac est passée à 2998.55MHz
icon1.gif   VC; Largeur impulsion Timing camera 
Les largeurs des impulsions de synchronisation de toutes les caméras de ThomX sont passées à 10µs (last value 5µs)

Camera linac TL1 TL2 TL3 EL DG spare et laser PC
Entry   VC; procedure fréquence 
dossier  panneau\synchro   (cdi)

./ring_frequency.py --help  (voir le mode de fonctionnement)

./ring_frequency.py --freq "value"   (choisi que des fréquences possible pour la div par 15)
Entry   VC; MESURE STABILITÉ SYNCHRO 
La synchronisation des signaux  mesure suR le timing 50Hz

500MHz LI 500MHz RI  => 18ps sdev

500MHz LI 50Hz  => 190ps sdev
Entry   VC; Rapport frequence anneau 
probleme de saute sunchro (50Hz)

avec le programme ./ring_frequency.py --read  (les fréquence  lues sont validées directement sur les générateurs
anneaux)
Entry   VC; Double pulses sur les DGs 
Une solution pour palier au double pulses sur les voie de DG:

 

il faut mettre un retard sur une des voies supérieur à 195µs
Entry   VC; réglage DEG4 --> DEG1 
Gen4, voie 1 => Gen1,voie2, RF Gun

Gen4, voie 2 => Gen1,voie3, Laser

Gen4, voie 6 => Gen1,voie4, RedPitaya
ELOG V3.1.4-395e101